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【求助】设计一个截止频率比较低的滤波器。
采样频率2.5mHz,截止频率大概有15Hz,1.5Hz,150Hz几种,过渡带没有明确要求,在1kHz左右有-20db以上的增益就好。不知用IIR或者FIR哪种结构比较好?因为用它来生成verilog代码烧在fpga里面,需要尽可能用少的硬件乘法和寄存器资源,用定点数,那些coefficient,input/output/filter internal这些参数分别代表是东西?初学者,求指教。。谢谢~~
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